무엇이 인증 대기 시간

인증 대기 시간이 지연,이 클럭 사이클, 사이의 시간에 프로세서를 요청의 데이터를 메모리와 시간의 메모리를 사용할 수있는 데이터의 첫 번째 부분을 읽을 수있습니다. sdr - sdram 모듈있을 인증 대기 시간은 1, 2 또는 3입니다. ddr - sdram 모듈에는 인증 대기 시간은 2 또는 2.5입니다. 인증 기관 인증 기관 또는 cl로 줄여 대기 시간은 종종있습니다. 예를 들어, pc133 모듈있을 수있습니다 분류 cas2, 인증 기관 - 2, 인증 기관 = 2, 2, cl - 2, 또는 cl = 2, 모두 어떤 의미하는 모듈에는 인증 대기 시간은 2.

  

현재의 시스템을 읽어 메모리의 32 - 비트 덩어리,들로 네 개의 8 - 비트 바이트입니다. 인증 기관의 수를 지정합니다 클럭 사이클을 요구하기 전에 대기 시간의 첫 번째 바이트 읽을 수있습니다. 그 후 첫 번째 바이트는 읽기, 나머지 바이트들은 읽기하지 않고 대기 시간을 한 클럭 사이클 각합니다. 예를 들어, cl3 메모리를 제공의 첫 번째 바이트 이후 3 개의 클럭 사이클을하고 다른 3 개의 바이트가 하나의 클럭 사이클 각합니다. 이 메모리 타이밍은 지정된 3-1-1-1을 나타내는 6 개의 클럭 사이클 (3 +1 +1 +1)이 필요를 읽는 모든 4 바이트입니다. 2 메모리를 사용하는 2-1-1-1 메모리 타이밍, 그리고 그러므로 모든 4 개의 바이트가 5 개의 클럭 사이클을 읽는다 (2 +1 +1 +1)입니다. 이와 비슷하게, cl1 메모리를 사용하는 1-1-1-1 메모리 타이밍과 필요에 읽기 전용 4 개의 클럭 사이클을 완료합니다.

이 기준을 하나의가 능성을 체결하는 2 메모리는 16.7%보다 빠른 속도로 cl3 메모리와 cl1 메모리는 33.3%보다 빠른 속도로 cl3, 이것은 상당한 차이가있습니다. 사실,이 차동 보유에 대해서만 단일 32 - 비트를 읽습 반면 대부분을 읽습는 스트리밍합니다. 스트리밍을 읽는 동안, 각 32 - 비트 읽은 후 첫 번째는 대기 시간없이 수행합니다. 스트리밍 32 - 비트를 읽습으로의 수를 1 인당 액세스 향상, 대기 시간 오버헤드 요청에 따른 상대적인 의미의 인증 기관의 첫 번째 바이트 인내력입니다.

예를 들어, 비교 스트리밍 32 - 바이트 읽기 (8 개 순차 32 - 비트를 읽습니다)와 함께 cl3 대 2 대 cl1 메모리입니다. 함께 cl3 메모리, 첫 32 - 비트 읽기 6 개의 클럭 사이클이 필요합니다. 각각은 다음과 같은 7 개의 32 - 비트를 읽습하지 않는다 지연 벌금이 부과될가 인증 기관 등 4 개의 클럭 사이클만을 필요로합니다. 전체 32 - 바이트 읽기 따라서 필요로 총 6 + (7 * 4), 34 클럭 사이클을합니다. 와 함께 2 메모리, 첫 32 - 비트 읽기가 필요 5 개의 클럭 사이클, 그리고 각은 다음과 같은 7 개의 32 - 비트를 읽습을 다시 요구에만 4 개의 클럭 사이클을 위해 총 33 클럭 사이클을합니다. 함께 cl1 메모리, 모두 8 개의 32 - 비트를 읽습 4 개의 클럭 사이클을 필요로 각, 예를은 총 32 클럭 사이클을합니다. 이 (가 매우 현실적)을 들어, 2 메모리가 실제로 불과 2.9 %보다 빠르게 (1 / 34)보다 cl3 메모리 및 cl1 메모리는 전용 5.9% (2 / 34)보다 빠른 속도로 cl3.

이 연습을 통해 낮은 대기 혜택을 고도의 임의 읽기 작업을하지만 이렇게 작은하는 데 도움이 스트리밍 (순차) 읽기 작업을합니다. 일반적인 pc 읽기 작업을 사용 순차 읽기 작업을 복잡하게하고있는 것을 의미합니다 사소한 개선에 메모리 성능을 기대할 수있습니다 전용 메모리를 함께 사용할 경우에는 낮은 인증 대기 등급입니다. 그것의 상당을 지불에 대해 좀 더 많은 메모리를 사용하여보다 빠르게 인증 대기 시간이지만 그 이유에 대한 않습니다을 기대 할 수있습니다. (참조의 마지막 지점에서 다음 글머리 기호 목록입니다.)

계속 이러한 cl - 관련 이슈에 유의 :

이것은 문서가 추가 ing. 히다 해밀턴
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